在使用各种手段测试我们的 FIFO ip 之前，我们首先得写一个 testbench。testbench 是什么，Vivado 会告诉你就是一个普通的 v 文件。在这个 v 文件中，实例化需要被测试的模块，然后写一些激励语句：...
本节介绍一个米联客DDR3读写测试的工程，把一些难以理解的代码进行了注释，如果哪里有问题的话，感谢大家指出，最后对波形进行分析。
之前介绍的PCIe实物模型为PIO模式，可编程PIO模式，软件控制CPU在主机总线上发起一个存储器或IO读写总线周期，并以映射在PCIe设备地址空间的一个地址为目标，根据PCIe总线宽度的区别，在每个时钟周期内可以传输4个或者8个字节...
跨时钟域（CDC）的应从对亚稳定性和同步性的基本了解开始。用普通的话来说，亚稳定性是指不稳定的中间状态，但是在此状态下，任何微小的扰动将导致最终状态变为稳定状态，但是并不能保证最终的状态就是设计所期待的状态，换句话就...
在时间敏感型网络中（例如在IEEE TSN和IETF Detnet中）使用流重塑，以减少网络内部的突发性并支持计算保证的时延边界。使用每流调节器（例如令牌桶过滤器）或交错式调节器（与IEEE TSN异步流量整形（ATS）一样）执行此操作。两种类型的...
关于同步fifo的设计疑惑了半天，本以为这个代码是错的，后来自己又写了一遍，但是写到最后又觉得这个是正确的，主要是wr_cnt和rd_cnt的理解。
当异步FIFO读写端口的throught-put(吞吐量)不同时，会遇到数据丢失的问题，需要考虑FIFO中的深度问题，即为满足读写流畅不卡顿（数据不丢失）时，FIFO的deepth的最小值。...
上一篇将创建的设计模块分成了三个时钟层次的子系统，此时子系统之间的数据由于时钟未同步，导致数据在传播时，采样所得的数据会有错误，因此需要建立一个异步通道，使得各时钟通道之间的数据可以准确的被传输。...
线程池 【死磕Java并发】—–J.U.C之线程池：ThreadPoolExecutor
